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Features:
HIGH-SPEED
4K x 18 DUAL-PORT
STATIC RAM
IDT7034S/L
◆
True Dual-Ported memory cells which allow simultaneous
reads of the same memory location
using the Master/Slave select when cascading more than
one device
◆
◆
◆
◆
High-speed access
– Commercial: 15/20ns (max.)
– Industrial: 20ns (max.)
Low-power operation
– IDT7034S
Active: 850mW (typ.)
Standby: 5mW (typ.)
– IDT7034L
Active: 850mW (typ.)
Standby: 1mW (typ.)
Separate upper-byte and lower-byte control for multi-
plexed bus compatibility
IDT7034 easily expands data bus width to 36 bits or more
◆
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◆
M/ S = H for BUSY output flag on Master
M/ S = L for BUSY input on Slave
Interrupt Flag
On-chip port arbitration logic
Full on-chip hardware support of semaphore signaling
between ports
Fully asynchronous operation from either port
Battery backup operation—2V data retention
TTL-compatible, single 5V (±10%) power supply
Available in 100-pin Thin Quad Flatpack
Industrial temperature range (–40°C to +85°C) is available
for selected speeds
Functional Block Diagram
R/ W L
UB L
LB L
CE L
OE L
R/ W R
UB R
LB R
CE R
OE R
BUSY L
I/O 9L -I/O 17L
I/O 0L -I/O 8L
(1,2)
I/O
Control
I/O
Control
I/O 9R -I/O 17R
I/O 0R -I/O 8R
(1,2)
BUSY R
.
A 11L
A 0L
Address
Decoder
MEMORY
ARRAY
Address
Decoder
A 11R
A 0R
13
13
INT L
INT R
SEM L
(2)
CE L
OE L
R/ W L
ARBITRATION
INTERRUPT
SEMAPHORE
LOGIC
M/ S
CE R
OE R
R/ W R
SEM R
(2)
4089 drw 01
NOTES:
1. (MASTER): BUSY is output; (SLAVE): BUSY is input.
2. BUSY outputs and INT outputs are non-tri-stated push-pull.
JANUARY 2009
1
?2009 Integrated Device Technology, Inc.
DSC 4089/9
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